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Décodage d'adresses

SPDIF

Error Checking and Correction Memory

Le principe d'un décodage d'Adresse

Méthode électronique qu'utilisent les cartes informatiques (microprocesseurs) pour adresser un périphérique suivant son adresse. Ce décodage se fait à l'aide de fonctions logiques sous forme de circuits électroniques standards (portes TTL par exemple) mais peut être implanté dans le chipset de la carte mère.

Le nombre d'adresses maximales adressable par un microprocesseur dépend de la largeur de ce bus par la formule 2^X ou X représente le nombre de bits (lignes) du bus d'adresse.

Comme exemple, supposons le montage électronique suivant composé de 1 mémoire ROM de 2KB et de 1 mémoire RAM de 4 KB.

Les plages d'adresses sont suivant le schéma ci-dessous:

0000.0000.0000.0000 à 0000.0111.1111.1111 pour la ROM 1 (en hexadécimal, 0000$ à 08FF$)

0100.0000.0000.0000 à 0100.1111.1111.1111 pour la RAM 1 ( 4000$ à 4FFF$)

Les plages d'adresses inférieures (lignes A0 à A11) sont raccordées sur tous les circuits (de même que le bus de donnée et le bus de commande), le décodage ne se fera que sur les plages supérieures.

	Décodage Rom, les plages A11 à A15 doivent être à 0 pour la sortie du montage à 0 (CE est actif bas). L'utilisation de 2 portes découle des circuits TTL courants.
	Décodage de la RAM, les plages A12, A13 et A15 doivent être à 0, la plage A14 doit être à 1. La première porte NOR donne 1 pour les adresses A12, A13 et A15 à 0, la porte NAND suivante donnant 0 si la plage A14 est également à 1.

Ce décodage est complet dans le sens où les adresses non inclues dans les plages de la ROM et de la RAM ne sont pas accessibles. Dans le cas contraire, on parle de décodage partiel. Dans ce cas, une même zone mémoire peut être accédée par différentes adresses différentes.

Définitions connexes: Liste des adresses PC - GB - byte - octet

Portes logiques TTL: And - NO - NAND

Dernière mise à jour, le 25/01/2021